Altera SDI Audio IP Cores Uživatelský manuál Strana 40

  • Stažení
  • Přidat do mých příruček
  • Tisk
  • Strana
    / 49
  • Tabulka s obsahem
  • KNIHY
  • Hodnocené. / 5. Na základě hodnocení zákazníků
Zobrazit stránku 39
SDI Clocked Audio Output Registers
The following tables list the registers for the SDI Clocked Audio Output IP core.
Table 5-7: SDI Clocked Audio Output Register Map
NameBytes Offset
Channel 0 Register00h
Channel 1 Register01h
FIFO Status Register02h
FIFO Reset Register03h
Table 5-8: SDI Clocked Audio Output Registers
DescriptionAccessNameBit
Channel 0 Register
The user-defined channel number of audio channel 0.RWChannel 07:0
Channel 1 Register
The user-defined channel number of audio channel 1.RWChannel status RAM select7:0
FIFO Status Register
This sticky bit reports the overflow of the clocked audio
output FIFO.
ROActive channel7:0
FIFO Reset Register
Reserved for future use.WOUnused6:0
Resets the clocked audio FIFO.WOFIFO reset7
Altera Corporation
SDI Audio IP Registers
Send Feedback
5-9
SDI Clocked Audio Output Registers
UG-SDI-AUD
2014.06.30
Zobrazit stránku 39
1 2 ... 35 36 37 38 39 40 41 42 43 44 45 ... 48 49

Komentáře k této Příručce

Žádné komentáře